routing पर टैग किए गए जवाब

मुद्रित सर्किट बोर्ड (पीसीबी) के मार्ग से संबंधित प्रश्न जिसमें बोर्ड पर पटरियों की नियुक्ति शामिल है। यह मैन्युअल रूप से प्रदर्शन किया जा सकता है, हालांकि कई पीसीबी सीएडी प्रोग्राम प्रक्रिया में सहायता के लिए एक ऑटोरैटर प्रदान करते हैं।

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दो आईसी के बीच एक थरथरानवाला साझा करना
मेरे पास एक ही बोर्ड पर एक माइक्रोकंट्रोलर और एक FPGA है। यदि वे दोनों एक ही घड़ी की गति से चलने वाले हैं, तो क्या मैं उन दोनों को देखने के लिए एक ऑसिलेटर का उपयोग कर सकता हूं? ऐसा लगता है कि कुछ ऐसा है जिसे मुझे यहां …
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क्या मैं FR4 PCB पर I2C लाइनों के निशान को रूट करने पर vias डाल सकता हूँ?
मैं 100kHz पर I2C पर MSP430FR2633 माइक्रो कंट्रोलर और ADS122C04IPWR DAC का उपयोग कर रहा हूं। क्या मैं 2 लेयर पीसीबी में vias के माध्यम से I2C लाइनों को रूट कर सकता हूं?
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जमीनी विमानों को एक साथ कैसे जोड़ा जाए
जमीनी विमानों को एक साथ जोड़ने का सबसे अच्छा तरीका क्या है? मुझे पता है कि ग्राउंड प्लेन पूरे बोर्ड में कम प्रतिबाधा वाले जीएनडी को रखने और सिग्नल के लिए वापसी का रास्ता प्रदान करने के लिए कई स्थानों पर एक साथ जुड़े हुए हैं। लेकिन, इसके अलावा हर …
11 pcb  layout  ground  routing  via 
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एक पीसीबी में 3 निशान कैसे जुड़ते हैं?
आमतौर पर मैं अपने पीसीबी को कभी भी 90º का मोड़ नहीं देता, क्योंकि बेस्ट प्रैक्टिस की सलाह देते हैं, लेकिन कभी-कभी ऐसे बिंदु होते हैं कि 3 निशान होने चाहिए, अगर मैं हमेशा 45, मोड़ दूं, तो इस चौराहे में 90º मोड़ होगा, इसलिए यह ठीक है, या वहाँ …
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क्या IC के तहत VCC / GND निशान का चूहों-घोंसला होना सामान्य है?
मैं एक साधारण बोर्ड को रूट करने का प्रयास कर रहा हूं, पहली बार मैंने 15 वर्षों में किया है क्योंकि मैंने mspaint के बराबर में 12V रैखिक बिजली की आपूर्ति को पार किया है। इस बोर्ड में मुख्य रूप से एक LPC2387 शामिल है, जो एक LQFP100 IC है …
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एक बार में सभी राउटिंग और राउटिंग साइज़ बदलना (Altium Designer, PCB Design)
मेरे पास Altium डिज़ाइनर द्वारा तैयार एक पीसीबी का पूरा डिज़ाइन है। मैं आकारों के माध्यम से बढ़ाना चाहता हूं। लेकिन उनमें से बहुत अधिक हैं, और उन सभी को एक-एक करके बदलना बहुत लंबा और परेशान करने वाला काम होगा। क्या कोई ऐसा तरीका है जिससे मैं उनका चयन …
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जमीन की परतें शीर्ष परत पर एक दूसरे से अलग क्यों होती हैं?
मैं LM3409 मूल्यांकन बोर्ड के बारे में TI से आवेदन नोट पढ़ रहा हूं । बोर्ड लेआउट (चित्रा 3) में नीचे की परत एक एकल GND डालना है। लेकिन शीर्ष परत में कुछ तांबा भी होता है, जो अंत में जमीन से जुड़ा होता है, जैसे कि LED-, C5, D1 …
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एक दो परत बोर्ड में कैपेसिटर के डिकूपिंग के साथ सिग्नल रिटर्न पथ का अनुकूलन करें
मैं एक बहुत ही जटिल दो लेयर बोर्ड डिजाइन कर रहा हूं - मुझे वास्तव में 4 लेयर वन के लिए जाना चाहिए, लेकिन यहां बात नहीं है। मुझे कंपोनेंट रखने और राउटिंग के साथ किया जाता है और मैं फिनिशिंग टच कर रहा हूं जैसे कि यह सुनिश्चित करना …
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क्या मेरा FPGA रूटिंग संसाधनों से बाहर है?
मेरे पास एक सीरियल-एटीए नियंत्रक डिज़ाइन है जो आर्टिक्स -7 डिवाइस को छोड़कर लगभग किसी भी तरह के Xilinx 7-सीरीज डिवाइस पर काम कर रहा है, जो मुझे सिरदर्द देता है ... मेरे Artix-7 200T पर शुद्ध डिज़ाइन (SATA 6.0Gb / s, 150 MHz डिज़ाइन घड़ी) को लागू किया जा …
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इस लेआउट को कैसे सुधारा जा सकता है? (असतत चुंबकत्व और POE के साथ गिगाबिट ईथरनेट)
उत्तर: नहीं, लेआउट के साथ कुछ भी गलत नहीं है, यह पता चलता है कि ईथरनेट ट्रांसफॉर्मर सम्मिलन हानि पर 0.2dB द्वारा कल्पना से बाहर था, जब हम उपयोग कर रहे PHY IC के साथ जोड़ा जाता है। सवाल क्या गीगाबाइट ईथरनेट के पीसीबी मार्ग के साथ कुछ गलत है? …
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क्या कोई ऐसा आईसी मौजूद है जो सिग्नलों की उड़ान भरने की अनुमति देता है?
क्या N इनपुट पिन और N आउटपुट पिन के साथ IC मौजूद है, जो या तो EEPROM सेटिंग के माध्यम से या माइक्रो-कंट्रोलर द्वारा ऑन-द-फ्लाई कंट्रोल के माध्यम से, किसी भी N आउटपुट में से प्रत्येक N इनपुट को रूट करने की अनुमति देता है? दूसरे शब्दों में, उदाहरण के …
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संश्लेषित रोम कोर के साथ एक साधारण परीक्षण बेंच का अनुकरण
मैं FPGA की दुनिया के लिए पूरी तरह से नया हूं और सोचा था कि मैं एक बहुत ही सरल परियोजना के साथ शुरू करूंगा: एक 4-बिट 7-खंड डिकोडर। पहला संस्करण जो मैंने विशुद्ध रूप से वीएचडीएल में लिखा था (यह मूल रूप से एक एकल दहनशील select, आवश्यक घड़ियां …
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