cpu-architecture पर टैग किए गए जवाब

सीपीयू आर्किटेक्चर अपने निर्माता द्वारा महसूस किए गए सीपीयू के डिजाइन के बारे में मापदंडों के एक संग्रह को संदर्भित करता है, जैसे: इसकी बिट-नेस या डेटा बस की चौड़ाई (16, 32, 64 बिट्स), निर्देश सेट (RISC, CISC, ...)। मेमोरी मैनेजमेंट, थ्रेडिंग, वर्चुअलाइजेशन सपोर्ट आदि

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धीमी गति के साथ एक नया प्रोसेसर तेजी से विरासत अनुप्रयोगों को चलाएगा?
मैं लिनक्स का उपयोग कर रहा हूं और 3 GHz घड़ी की गति के साथ एक पुराना P4 है। क्या एक नई चिप जिसमें धीमी घड़ी की गति थी, मेरी विरासत अनुप्रयोगों को तेज या धीमी गति से चलाएगी? मैं केवल एक समय में एक एप्लिकेशन का उपयोग करता हूं, …

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क्या सीपीयू क्लॉक फ्रीक्वेंसी ऑन डिमांड बदलती है?
मेरी मशीन पर (व्यक्तिगत कंप्यूटर नहीं), मेरे पास 4 कोर (2.4GHz) हैं और वर्तमान में मेरे पास कोई महत्वपूर्ण प्रक्रिया नहीं है। अभी, मेरे सभी 4 कोर चल रहे हैं / 2.4GHz पर हिल रहे हैं या उनमें से कुछ धीमे चल रहे हैं या यहां तक ​​कि मोबाइल भी …


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हमें कैश मेमोरी के कई स्तरों की आवश्यकता क्यों है?
सामान्य तौर पर एक कैश मेमोरी उपयोगी होती है क्योंकि प्रोसेसर की गति रैम की गति से अधिक होती है (वे दोनों गति में वृद्धि कर रहे हैं लेकिन अंतर अभी भी बना हुआ है)। इसलिए मेमोरी एक्सेस की संख्या को कम करना प्रदर्शन को बढ़ाने के लिए वांछनीय है। …

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कंप्यूटर आर्किटेक्चर: DDR3 मेमोरी टेक्नोलॉजी - स्लॉट क्षमता स्केलिंग
कंप्यूटर आर्किटेक्चर के संदर्भ में बोलते हुए, डीडीआर 3 मेमोरी मॉड्यूल या होस्ट स्लॉट में क्या विशेषताएँ निहित हैं, जैसे कि कोई उपयोगकर्ता अपने पीसी को बूट करने में विफल होने के बिना मेनबोर्ड के प्रति-स्लॉट विनिर्देश की तुलना में बड़ा रैम नहीं लगा सकता है? क्या सीमा की वजह …

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CISC और VLIW, और निर्देश और opcode
से http://en.wikipedia.org/wiki/Instruction_set CISC प्रोसेसर उनके निर्देश सेट में "जटिल" निर्देश शामिल करते हैं। एक एकल "जटिल" निर्देश कुछ ऐसा करता है जो अन्य कंप्यूटरों पर कई निर्देश ले सकता है। ऐसे निर्देशों को निर्देश द्वारा टाइप किया जाता है जो कई कदम उठाते हैं, कई कार्यात्मक इकाइयों को नियंत्रित करते …


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