असत्य पथ समय बाधा क्या है?


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FPGA की दुनिया में, HDL कंपाइलर के लिए वास्तव में क्या गलत रास्ते हैं? वे उपयोगी क्यों हैं?


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यह एक डिजिटल अवधारणा है, न कि केवल एक FPGA अवधारणा।
W5VO

जवाबों:


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झूठे रास्ते समय के पथ हैं जिन्हें कभी भी अंतिम डिजाइन में प्रयोग नहीं किया जाएगा। मान लीजिए कि आप 4-बिट काउंटर डिज़ाइन कर रहे हैं और यह पता चला है कि 12 से 13. की ​​बढ़ोतरी के दौरान बहुत धीमी गति से विलंब का मार्ग है। यदि आपका डिज़ाइन हमेशा काउंटर को रीसेट करता है जब भी गिनती 9 के बराबर होती है तो वह धीमा रास्ता कभी नहीं देखा जाएगा। वास्तविक डिजाइन। आप धीमे पथ को झूठे मार्ग के रूप में लेबल करते हैं ताकि कंपाइलर किसी भी समय खर्च न करें, या गलत पथ को तेज़ी से चलाने के प्रयास में कोई अतिरिक्त तर्क न जोड़े।


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हुह, और मुझे लगा कि गलत रास्ते का उपयोग PICs या कुछ के बजाय Atmels का उपयोग करना है।
ओलिन लेथ्रोप

एक और महत्वपूर्ण प्रकार का झूठा रास्ता मुझे लगता है कि एक संकेत है जो एक घड़ी के किनारे पर बदलता है और एक अलग घड़ी के किनारे पर नमूना होता है, लेकिन या तो संकेत दूसरी घड़ी के परिवर्तन के समय या कहीं भी पास होने पर वास्तव में कभी भी नहीं बदलेगा यह कुछ भी नहीं बदलता है इसके मूल्य के बारे में परवाह नहीं करेगा। समय विश्लेषण विश्लेषण उपकरण तब तक विफल हो जाते हैं जब तक कि कोई एक डबल सिंक्रोनाइज़र नहीं जोड़े जो कि दूसरी घड़ी द्वारा नियंत्रित किया गया था, लेकिन इस तरह के सिंक्रनाइज़र को जोड़ने से डिज़ाइन पूरी तरह से टूट सकता है। उदाहरण के लिए, पहली घड़ी 1 मेगाहर्ट्ज पर और दूसरी 32KHz पर चल सकती है, लेकिन ...
सुपरकैट

... सिग्नल उत्पन्न करने वाला उपकरण 32KHz घड़ी पर बढ़ती बढ़त देखने के बाद इसे तीन 1MHz चक्र बदल सकता है। नतीजतन, 32kHz घड़ी के द्वारा लगाए गए सिग्नल को बिना किसी अतिरिक्त सिंक्रनाइज़ेशन के 32kHz कुंडी के नमूने / पकड़ आवश्यकताओं के अनुपालन की गारंटी दी जा सकती है। यदि 1 मेगाहर्ट्ज की तरफ के तर्क ने 32KHz के पक्ष में किए गए आंकड़ों के आधार पर अपने डेटा को उत्पन्न किया, तो ऐसा डिज़ाइन 32Khz पक्ष पर एक चक्र पर उत्पन्न जानकारी को अगले चक्र द्वारा दोनों तरीकों से नष्ट करने की अनुमति दे सकता है। 32Khz पक्ष के लिए डबल सिंक्रनाइज़ेशन जोड़ने से वह टूट जाएगा।
सुपरकैट

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एक झूठा रास्ता एक पथ है जो डिज़ाइन में मौजूद है, लेकिन ऑपरेशन में एक भूमिका नहीं निभाता है, इसलिए इसे समय विश्लेषण में शामिल करना आवश्यक नहीं है।
मामला होने के कई कारण हो सकते हैं, लेकिन चूंकि समय विश्लेषण उपकरण आमतौर पर नहीं जानता (हालांकि कुछ उपकरण हैं जो उन्हें पता लगा सकते हैं) कौन से रास्ते का उपयोग किया जा सकता है या नहीं, आपको यह बताना होगा। यह एक बहु-चक्र पथ के समान है, जहां आप यह बता सकते हैं कि एक निश्चित पथ को पूरा करने के लिए एक से अधिक चक्र का उपयोग करने की अनुमति है।

एक उदाहरण (एक झूठा रास्ता) एक रजिस्टर है जिसे एक बार पावर अप पर लिखा जा सकता है, लेकिन फिर उसी स्थिति में रहता है।


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बस, एक झूठा रास्ता एक तर्क पथ है जिसे आप यह देखने के लिए जाँचने से बाहर रखना चाहते हैं कि क्या यह समय विश्लेषण के दौरान समय से मिलता है। रास्तों को बाहर करने के दो कारण हैं, पहला यह कि झूठा मार्ग उस संकेत के लिए समय को पूरा करने के लिए उपकरणों को अधिक कठिन बना देगा, जो बदले में वैध सिग्नल पथों को प्रभावित करेगा, संभवतः अतिरिक्त समय त्रुटियों का कारण बन सकता है और क्योंकि यह समय विफलता की रिपोर्ट करने में समय की जाँच का कारण बनेगा संभवतः वैध समय त्रुटियों से डिजाइनर विचलित हो रहा है।

गलत पथ असंबंधित अतुल्यकालिक घड़ियों या एक ही आवृत्ति की घड़ियों के बीच तर्क पथ के कारण होते हैं, लेकिन अज्ञात चरण संबंध या एक पथ के साथ जो सामान्य सर्किट ऑपरेशन के दौरान कभी भी सक्रिय नहीं होगा। किसी पथ को नजरअंदाज करने के लिए उपकरण को समय पर काम करना केवल उस समय की जाँच नहीं है। यह डिज़ाइनर पर निर्भर है कि मैन्युअल रूप से बीमा करने के लिए सही सिंक्रनाइज़ेशन लॉजिक का उपयोग इन उपेक्षित सिग्नल पथों के लिए किया जाता है।

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