मल्टी-सीपीयू सिस्टम में सीपीयू का मिश्रण


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RAM के प्रकारों को मिलाना हमेशा स्वस्थ नहीं होता है, लेकिन मैं उत्सुक हूं कि सिस्टम में CPU प्रकारों को मिलाते समय क्या होता है (यदि कुछ भी)।

उदाहरण:

  • सॉकेट 0 में 8-कोर 2.0Ghz मैगी कोर्ट्स CPU
  • सॉकेट 1 में 12-कोर 2.0Ghz मैगी कोर्ट्स CPU

क्या इस बारे में कुछ "बुरा" है? सीपीयू है है , मैच के लिए या केवल एक अच्छा विचार ™ है?

जवाबों:


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बस सही ढंग से काम नहीं करेगा। वे जरूरी मैच। यहां तक ​​कि अगर आप किसी तरह उन्हें काम करने में कामयाब रहे, तो मैं बुरी और अप्रत्याशित चीजों की भविष्यवाणी करता हूं।

इसका कारण माइक्रोफ़र्मवेयर कोड के लिए प्रासंगिक हो सकता है, सीपीयू इनर स्टोरेज पर अपलोड किया जा रहा है, जब BIOS POST सिलिकॉन बग्स का पैचिंग करता है। पैचिंग रूटीन केवल 1 सीपीयू स्टेपिंग को चेक करने का फैसला कर सकता है और बिना चेक के 2 सीपीयू पर एक ही पैच लागू कर सकता है। Hipotetically। लेकिन किसे पता है कि वास्तव में POST में क्या हो रहा है।

सीमाओं को खोजने के लिए आपको निर्माता के दस्तावेज (सीपीयू और मदरबोर्ड दोनों के लिए) पर जाना होगा। इस तरह के बहुत अलग CPUs के रूप में आप सूची ठीक से काम करने की संभावना नहीं है। अतीत में, सीपीयू जो सटीक स्टेपिंग स्तर के अलावा कभी-कभी समान थे, यहां तक ​​कि एक साथ उपयोग करने में सक्षम नहीं थे। "निर्भर करता है"।

आपको ब्रिज चिप्स, मदरबोर्ड और OS से समर्थन चाहिए। इन सभी को सीपीयू के असंतुलन के साथ काम करने के लिए कॉन्सर्ट में काम करना होगा। उन्हें बहुत कम लाभ (एक बराबर सीपीयू कॉन्फिगरेशन) के लिए कई संयोजनों के लिए प्रोग्रामिंग और गहन परीक्षण से गुजरना होगा।


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यह समझाने की परवाह करें कि ऐसा क्यों है?
इवो ​​फ्लिप

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इसका कारण माइक्रोफ़र्मवेयर कोड के लिए प्रासंगिक हो सकता है, सीपीयू इनर स्टोरेज पर अपलोड किया जा रहा है, जब BIOS POST सिलिकॉन बग्स का पैचिंग करता है। पैचिंग रूटीन केवल 1 सीपीयू स्टेपिंग को चेक करने का फैसला कर सकता है और बिना चेक के 2 सीपीयू पर एक ही पैच लागू कर सकता है। Hipotetically। लेकिन किसे पता है कि वास्तव में POST में क्या हो रहा है।

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@Arren - KCotreau का पोस्ट अन्य लोगों से समान उत्तर क्यों देता है?
रामहुंड

@ राममाउंड - क्योंकि मैंने एफएक्यू के
वॉरेन

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@Shinrai - मैं बहस चाहते हैं कि यह है वास्तव में में उत्तर संपादित करने में सक्षम होने के उद्देश्य के लिए सबसे अच्छा एक संभव
वॉरेन

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सीमाओं को खोजने के लिए आपको निर्माता के दस्तावेज (सीपीयू और मदरबोर्ड दोनों के लिए) पर जाना होगा। इस तरह के बहुत अलग CPUs के रूप में आप सूची ठीक से काम करने की संभावना नहीं है। अतीत में, सीपीयू जो सटीक स्टेपिंग स्तर के अलावा कभी-कभी समान थे, यहां तक ​​कि एक साथ उपयोग करने में सक्षम नहीं थे। "निर्भर करता है"।


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मेरा अनुमान नहीं है।

हमें इसे काम करने के लिए क्या चाहिए? आपको ब्रिज चिप्स, मदरबोर्ड और OS से समर्थन चाहिए। इन सभी को सीपीयू के असंतुलन के साथ काम करने के लिए कॉन्सर्ट में काम करना होगा। उन्हें बहुत कम लाभ (एक बराबर सीपीयू कॉन्फिगरेशन) के लिए कई संयोजनों के लिए प्रोग्रामिंग और गहन परीक्षण से गुजरना होगा। मैं यह काम नहीं कर रहा हूँ अनुमान लगा रहा हूँ।

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