मेरा गोटो CMOS समाधान
सभी तर्क I / O में Vdd और Vss के बीच रैखिक क्षेत्र में एनालॉग विशेषताएं हैं।
किसी भी तर्क परिवार का उपयोग किया जा सकता है, यह समझते हुए कि नकारात्मक प्रतिक्रिया रैखिक एम्पलीफायरों को एकता के लाभ और Vdd और आपूर्तिकर्ताओं के लिए संवेदनशीलता पर अच्छा चरण मार्जिन होना चाहिए।
- जोड़ा गया
74HCT या कोई 74xxT VD / 2 के बजाय 1.5V पर टीटीएल इनपुट थ्रेशोल्ड संगत है जो कि वही चीज है जब आप Vdd = 3V पर जाते हैं। नकारात्मक आर प्रतिक्रिया के साथ स्व-पूर्वाग्रह के साथ आउटपुट ड्यूटी चक्र इनपुट पर 1.5Vdc तक पहुंचने की कोशिश कर रहा है, इसलिए सिग्नल स्तर के आधार पर जो जमीन पर ESD क्लैंप डायोड को ट्रिगर कर सकता है
हर कोई पहली बार सफल नहीं होगा, जैसे कि सर्किट और आपूर्ति के प्रति पूर्ण जागरूकता के बिना लीनियर और आरएफ डिजाइन में, सस्ते और गंदे CMOS बफर बफर इन्वर्टर का अद्भुत लाभ बैंडविड्थ उत्पाद> 150MHz के साथ> 60dB प्रति पैसे के हिसाब से हासिल होता है। इन्वर्टर।
इनपुट एसी कपल होने पर सेल्फ-बायसिंग तुच्छ है, लेकिन बफर इनवर्टर का चुनाव तकनीकी चुनौती को बढ़ाता है। दोलन की संवेदनशीलता बढ़ जाती है, जब बंद लूप लाभ ओपन लूप लाभ की तुलना में बहुत कम होता है क्योंकि यह ओप एम्प्स (ओए) की तरह आंतरिक रूप से मुआवजा नहीं दिया जाता है।
- बफर इनवर्टर को OA की तुलना में अधिक लाभकारी वीडियो एम्पलीफायरों की तरह व्यवहार किया जाता है।
1-स्टेज इन्वर्टर या अनफर्ड (UB) के लिए ओपन लूप का लाभ 20dB न्यूनतम और बफ़रेड (B) 3 चरणों के लिए 60dB है। जब Zf / Zs का उपयोग करते हैं, तो नकारात्मक प्रतिक्रिया के लिए एसी को इनपुट और आउटपुट को एक ही सप्लाई CMOS Op Amp में करना चाहिए। Zf को आमतौर पर इनपुट के कम वर्तमान स्वयं डीसी पूर्वाग्रह के लिए उच्च प्रतिरोध के साथ चुना जाता है, लेकिन बहुत अधिक होने पर R2C1 से Vdd / 2 को निपटाने वाले इनपुट वोल्टेज के लिए समय पर धीमी गति से मोड़ होगा।
इस सर्किट का अनुकरण करें - सर्किटलैब का उपयोग करके बनाई गई योजनाबद्ध
बफ़र किए हुए (B) इनवर्टर का 3 गुना डीबी रेखीय लाभ असंबद्ध (UB) होता है, ताकि वीडियो एम्पलीफायरों में रोचक व्यवहार हो, यदि आपको 20d से 500 ओम प्रति चालक ड्राइवर के साथ Zout के साथ 60dB का लाभ चाहिए। जहां Zout = RdsOn = Vol / Iol @ ~ x mA
अन्य जानकारी
1970 से सीएमओएस लॉजिक के इतिहास को देखते हुए, {4xxx, 'HCxxx &' ALCxx 'जैसे दर्जनों मानक पारिवारिक उपसर्ग हैं। सभी एनालॉग विशेषताओं को सीधे डेटाशीट, जैसे कि RdsOn, Ciss और Coss में निर्दिष्ट नहीं किया जाता है, लेकिन हम इन सीमाओं को वर्तमान नाली और बड़े सिग्नल बैंडविड्थ के रूप में जानते हैं। आप FET के व्यवहार की सराहना कर सकते हैं जैसे RdsOn बनाम Vgs Vss रेंज द्वारा निर्धारित किए जाते हैं और यह कि प्रत्येक पीढ़ी या तो गति बढ़ाती है, गति से बिजली की खपत कम करती है या दोनों। इसके परिणामस्वरूप छोटी लिथोग्राफी, कम वीडीएस पर्वतमाला और निचले आरडीएसओएन चालक मूल्य शामिल थे।
- आप पहले से ही जानते होंगे कि आरडीएसओएन प्रत्येक 54/74 सीएमओएस श्रृंखला परिवार के लिए काफी सुसंगत (50%) है जो वीएसएस पर निर्भर है। चूंकि बढ़ती वीजीएस स्वाभाविक रूप से आरडीएसओएन को कम करती है। कम Vss रेंज, RdsOn से महत्वपूर्ण गति से सीमित होती है और उच्च श्रेणी क्रॉस-कंडक्शन करंट और पावर अपव्यय को जन्म देती है।
मैं उम्मीद करता हूं (लेकिन सत्यापित नहीं किया गया है) प्रत्येक तर्क परिवार को एक रैखिक एम्पलीफायर के रूप में इस्तेमाल किया जा सकता है । प्रत्येक रैखिक amp। रैखिक और स्थिर बनाने के लिए नियमों का पालन करना चाहिए। हालाँकि, लेआउट इंडक्शन और अन्य प्रतिबाधा के आधार पर एकता लाभ चरण के मार्जिन को प्रभावित करते हुए, 1 ऑर्डर पोल के लिए बाहरी मुआवजे के रूप में आवश्यक हो सकता है कि घुटने को कैसे ऑप्स डिजाइन किया जाता है।
सर्वोत्तम परिणामों के लिए, डिजाइनर को सभी आवेगों का एक अच्छा विचार होना चाहिए * सर्किट की आवृत्ति का जेड (एफ), भले ही सभी आपूर्तिकर्ताओं के लिए ~ +/- 50% की व्यापक सहिष्णुता हो। कभी भी यह न समझें कि ये महत्वपूर्ण रूप से बदल सकते हैं, इसलिए आपकी स्वीकृत सूची सूची, AVL में वे ही शामिल होने चाहिए जिन्हें आपने किसी भी डिज़ाइन में प्रत्येक भाग संख्या के लिए सत्यापित किया है। अन्यथा आपको यह पता लगाना चाहिए कि डिजाइन और परीक्षण द्वारा इन समस्याओं से कैसे बचा जाए। लेकिन आम तौर पर मुझे लॉजिक स्पेक्स मिले हैं जो आरडीएसओएन (या ड्राइवर ईएसआर) सीमा को दर्शाते हैं जो सभी विक्रेताओं के लिए संगत हैं।
- इन * में स्रोत के Z (f) और ड्राइवर प्रतिबाधा के Z (f) के एक स्रोत को शामिल किया गया है << Zout, लेआउट और प्रत्येक चिप भर में आपूर्ति के लिए ऑपरेटिंग बैंडविड्थ पर डिकूपिंग कैप्स। और CMOS Zout = RdsOn आउट। अप्रभावित इनवर्टर अधिक स्थिर थे और इसकी सिफारिश की गई थी क्योंकि क्रिस्टल ऑसिलेटर्स (एक्सओ) के लिए एकल चरण लाभ सामान्य रूप से पर्याप्त है जब स्व-डीसी 1 ~ 10M फीडबैक आर के साथ पक्षपाती है।
मुझे लगता है कि आपके पास नियंत्रण सिद्धांत या बोडे भूखंडों के कुछ विचार हैं। चूंकि प्रत्येक सीएमओएस चरण एक इन्वर्टर है, बफ़र किए गए इनवर्टर के पास G (s) के 3 चरण हैं और अधिक चरण शिफ्ट बनामचब व~0.35 टीआर और इस प्रकार अधिक प्रतिक्रिया एच (एस) के साथ कम स्थिरता।
जो आसानी से सीख सकते हैं, पहले से ही जानते हैं; बोड प्लॉट्स, प्रत्येक लॉजिक परिवार बनाम Vcc के लिए 1 बनाम 3 स्टेज एम्प्स, Vol / Iol का फेज मार्जिन। अन्यथा कोई सरल व्याख्या संभव नहीं। CD4xxx ने अच्छी तरह से काम किया 3 ~ 18V, अन्य सभी को Vcc / RdsOn को स्केल करके समान काम करना चाहिए। कम प्रतिबाधा भार (~ 50) के लिए, ड्राइवर में पीडी को एसी युग्मन द्वारा बहुत कम किया जा सकता है। 74ALxx में लगभग 25 ओम @ 3.3V, 74HCxx में लगभग 50 ओम +/- 50% @ 5V ओवर टेम्प है।