इस फ्लिप-चिप BGA के नीचे के हिस्से में छोटे-छोटे निशान क्यों हैं?


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मैं रिवर्स इंजीनियरिंग का एक एम्बेडेड सिस्टम हूं, जिस पर एआरएम एसओसी है। मेरे पास कोई डेटाशीट नहीं है, इसलिए मैं जांच के साथ काफी गहराई से जा रहा हूं।

इसे एक ढक्कन रहित फ्लिप-चिप BGA में पैक किया गया है। वाहक सब्सट्रेट है कि मरने पर मुहिम शुरू की है पिन के कार्य के लिए सुराग प्रदान करता है, इसलिए मैं माइक्रोस्कोप के तहत SoC की जांच कर रहा था।

मैंने देखा है कि सोल्डर मास्क और तांबे की बाहरी परत के माध्यम से कई सारे कट होते हैं। उन्होंने गेंदों के बीच के निशान काट दिए।

BGA के अंडरसाइड का अवलोकन: बीजीए के अंडरसाइड का अवलोकन

कुछ नजारे देखें: कुछ नजारों का दृश्य

गहराई दिखाते हुए तिरछा दृश्य: ओब्लीक दृश्य गहराई दिखा रहा है

निशान द्वारा काटे जा रहे निशान: निशान से काटे जा रहे निशान

मेरा प्रारंभिक विचार यह था कि इनका उपयोग डिवाइस को कॉन्फ़िगर करने के लिए किया गया था, क्योंकि वे बिन किए गए थे। लगता है बहुत अधिक हालांकि - 452 पिन बीजीए पैकेज पर 50 से अधिक। ये किस काम की लिये प्रायोग होते है?

मैं यह भी बताती हूं कि उन्हें कैसे बनाया जाता है। उनके पास बहुत चौकोर भुजाएँ हैं और कोई भी अंडरकट नहीं दिया गया है कि वे केवल 0.25 मिमी लंबे, बहुत अधिक सत्तारूढ़ नक़्क़ाशी और लेजर हैं। मैं नहीं देख सकता कि कैसे एक यांत्रिक विधि को एक समान वर्दी मिलेगी।


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क्या आप कुछ गेंदों के आगे उजागर धातु के छोटे विकर्ण बिट्स की बात कर रहे हैं? यदि आप फ़ोटो में किसी एक के बारे में बात कर रहे हैं तो यह आपकी मदद कर सकता है। :)
डस्कवफ़

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यदि notches कुछ निशान काटते हैं, तो यह स्ट्रैप-आधारित कॉन्फ़िगरेशन हो सकता है। या सीरियल नंबर।
अले..चेंस्की

मुझे यकीन नहीं है कि वे "बिल्कुल" हैं। तस्वीरों में मैं जो देख सकता हूं, उससे ऐसा लग रहा है कि तांबा बरकरार है - इस पर कोई मिलाप नहीं है।
डस्कवफ-एक्टिव-

duskwuff - मैंने मंडलियां जोड़ी हैं। वे धातु उजागर नहीं कर रहे हैं, हालांकि, यह अंतर्निहित सब्सट्रेट है। वे notches हैं - जैसा कि मैंने ऊपर कहा था, वे मिलाप मुखौटा और तांबे के माध्यम से जाते हैं, जैसा कि आप गहराई देख सकते हैं और यह कि वे निशान काटते हैं।
साइबर्ग रिबन

जवाबों:


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मुझे लगता है कि लिंक चढ़ाना के लिए एक साथ पैड को टाई करने के लिए थे। यदि मैं सही हूं तो हर एक पैड का एक बार बाहर से संबंध होगा। आप शीर्ष पर पैटर्न को बंद करते हुए देख सकते हैं। चढ़ाना के बाद वे कनेक्शन बाहर सीएनसी मार्ग।

गेंद पैड के कई ग्राउंड और आपूर्ति रेल के लिए समूहों में एक साथ बंधे हैं, इसलिए प्रत्येक समूह के लिए केवल एकल निशान की आवश्यकता होगी।

एज कनेक्टर पैड प्लेटिंग के लिए अक्सर कुछ ऐसा ही किया जाता है- कनेक्शन बाद में बंद हो जाते हैं। मैंने इसे उन बोर्डों पर भी देखा है जो अस्थायी कनेक्शन को तोड़ने के लिए छेद के साथ छिद्रित होते हैं।


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मुझे लगता है कि आप डिवाइस कॉन्फ़िगरेशन के बारे में सही रास्ते पर हैं। वे लेजर फ्यूज़िबल लिंक प्रतीत होते हैं, "स्लॉट्स" में से कुछ नंगे सब्सट्रेट दिखाते हैं, अन्य में तांबा बरकरार है, जबकि कुछ तांबे में अंडाकार स्लॉट दिखाते हैं।

उनके उपयोग करने के कई कारण हो सकते हैं:

  • SoC की उपज में वृद्धि। चिप में n + 1 घटक है जैसे RAM बैंक, और n अच्छे घटक परीक्षण के दौरान चुने गए हैं।
  • एक परिवार में विभिन्न उपकरणों के लिए एक सामान्य BGA पदचिह्न का उपयोग करें।
  • विभिन्न निर्माताओं से मरने के साथ एक सामान्य बीजीए पदचिह्न का उपयोग करें।
  • एक विशिष्ट पहचान कार्यक्रम जैसे SoC में MAC पता।
  • विभिन्न बाजारों के लिए एक मानक उपकरण के BGA पदचिह्न को बदलें।

चूंकि स्लॉट्स सब्सट्रेट में जाने वाले निशानों के बजाय BGA गेंदों के बीच ओपन-सर्किट दिखाई देते हैं, मुझे पिछले कारण पर संदेह होगा। एक एकल डिवाइस का निर्माण करें, फिर कम खुदरा मूल्य डिवाइस पर बाह्य मेमोरी बस, इंटरफ़ेस पोर्ट, आदि जैसी अपंग सुविधाएँ।


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मेरी राय में, धातुकृत पटरियों के बीच प्रतिबाधा मिलान का अनुकूलन करना हो सकता है।

जैसा कि हम देख सकते हैं कि एक दृश्य परत पर कुछ पटरियों को रूट किया गया है (सोल्डर मास्क के नीचे पहली परत)। उन पंक्तियों का संचरण मोड माइक्रोस्ट्रिप या कॉपलनार ग्राउंडेड प्रकार हैं।

पीसीबी स्टैकअप (कितनी परतें?) की अन्य परतों में कोई अधिक क्षेत्र उपलब्ध नहीं होने के कारण डिजाइनरों को संभवतः उन लाइनों को बनाने की आवश्यकता होती है।

प्रतिबाधा मिलान क्यों? डिजिटल (और एनालॉग सिग्नल) में त्रुटियों और सिग्नल के नुकसान को कम करने और "आई डायग्राम" को खोलने के लिए, प्रतिबाधाओं का मिलान किया जाना चाहिए।

इसलिए हम देख सकते हैं कि "नट" केवल जुड़े पैड के बीच हैं। वे एक "मिलान नेटवर्क" का गठन कर रहे हैं जो एक विशिष्ट आवृत्ति बैंड के लिए डिज़ाइन किया गया है (जीएचजेड के ऊपर एक छोटे बैंडविड्थ की संभावना है)।

बॉल पैड से डिज़ाइन को देखते हुए, यह एक बहुत पतली रेखा के साथ जाता है जो वास्तव में उच्च आवृत्ति में एक अधिष्ठापन की तरह व्यवहार करता है, और फिर एक बड़ी लाइन (आयताकार पायदान) के साथ होता है जो उच्च आवृत्ति में एक समाई की तरह व्यवहार करता है, और फिर से पतली रेखा जब तक आप दूसरे पैड तक नहीं पहुंचते।

मेरे लिए, यह एक सामान्य Inductance - Capacitance- Inductance मिलान नेटवर्क जैसा दिखता है।

उन मिलानों को ध्यान में नहीं रखने से उच्च बाइनरी त्रुटि दर के साथ, कम प्रदर्शन करने वाले डिजिटल ट्रांसमिशन में परिणाम होगा।

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